在V5 --220T的開發(fā)板上設計一個LED跑馬燈實驗室時為什么要用到差分信號的技術呢？因為他將兩個信號偶合在一起,，并確保這兩個信號之間保持180度的理想相位偏移,，這可以解決噪聲問題。差分信號傳輸技術使信號源電流和反饋電流方向正好相反,。以信號源參考層來看,，這些電流的影響多半會互相抵消。若將接地或參考層的反饋電流全部加起來,，其總和好為零,。這使得耦合差分信號有較大的抑制噪音能力，免受來自參考層,、相鄰網(wǎng)絡及附近其他的電子噪音源產(chǎn)生的耦合電能影響,。在此用到的是IBUFGDS （帶可選端口的專用差分信號輸入緩存），程序中的IBUFGDS模塊是從Language Templates 中調(diào)用的原語（Primitive）,，原語在設計中可以直接例化使用,，是直接的代碼輸入方式。但只有相應配置的硬件才能執(zhí)行相應的原語,，并不是所有的原語都可以在任何一款芯片上運行,。
在編寫模塊代碼時先聲明的寄存器類型后聲明輸入或是輸出，本以為Verilog 是并行的執(zhí)行,，前后都沒關系呢,，結果綜合時出現(xiàn)了錯誤。所以得出結論：聲明變量時先聲明輸入或是輸出，然后再聲明寄存器類型或是wire型,。
分配管腳時clk_n和clk_p本來想的是分配到AP30和AN30,，結果分配時只能出現(xiàn)一個管腳的填寫，其實只要填上一個另一個自動分配,。因為clk_n和clk_p是IBUFGDS中的兩個輸入,，故輸入一個另一個就自動分配了。

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